[9급 국가직 전자공학개론 2015년 4번]

다음 회로에서 입력신호 $v_{in}$에 대한 전체 전압 이득 $v_{out}/v_{in}$은? (단, 연산증폭기는 이상적이라고 가정한다)

1. ①－12
2. ②－15
3. ③15
4. ④10

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