[7급 국가직 전자회로 2012년 20번]

다음 회로에 60 [Hz]의 교류전압이 입력되었을 때, 회로 동작에 대한 설명으로 옳지 않은 것은? (단, 연산증폭기의 특성은 이상적이라고 가정한다)

1. ①노드 A에는 전파(full-wave) 정류된 전압파가 출력되어 커패시터를 충전시키게 되며, 이 때 커패시터의 ${\mathrm{C}}_1$값을 작게 할수록 리플전압은 작게 된다.
2. ②노드 B의 전압이 제너전압 ${\mathrm{V}}_{\mathrm{Z}}$보다 클 때, 제너 다이오드는 도통 상태가 되어 노드 B의 전압이 ${\mathrm{V}}_{\mathrm{Z}}$를 유지하게 되며, 이 때 바이폴라 트랜지스터의 ${\mathrm{V}}_{\mathrm{BE}}$를 무시하면 ${\mathrm{V}}_{\mathrm{out}}$은 $(1+\frac{{\mathrm{R}}_2}{{\mathrm{R}}_3}){\mathrm{V}}_{\mathrm{Z}}$가 된다.
3. ③외부 요인으로 노드 C의 전압 ${\mathrm{V}}_{\mathrm{out}}$이 감소하면, $\frac{{\mathrm{R}}_3}{{\mathrm{R}}_2+{\mathrm{R}}_3}{\mathrm{V}}_{\mathrm{out}}$로 주어지는 노드 D의 전압이 감소하게 되며, 이는 연산증폭기 반전단자의 입력전압의 감소를 일시적으로 초래하게 된다.
4. ④노드 D의 전압이 감소하면, 연산증폭기의 출력전압은 증가하게 되며, 결과적으로 에미터 전류를 증가시켜 ${\mathrm{V}}_{\mathrm{out}}$을 증가시키게 된다.

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출처: 인사혁신처 공개 기출(공공데이터포털, 이용허락 제한 없음)